ICS8523BG - Integrated Device Technology Inc

Die Bilder dienen nur als Referenz Siehe Produktspezifikationen

Kynix Teil #: KY20-ICS8523BG
Hersteller Teil #: ICS8523BG
Produktkategorie: Logic - Counters, Dividers
Hersteller: Integrated Device Technology Inc
Beschreibung: Low Skew Clock Driver, 4 True Output(s), 0 Inverted Output(s), PDSO20, 6.50 X 4.40 MM, 0.92 MM HEIGHT, MS-153, TSSOP-20
Verpackung:
Menge:
Bleifrei-Status / RoHS-Status: Bleifrei / RoHS-konform
Vorlaufzeit: 3(168 Hours)
Spezifikationen
Attribute
Attribute Value
Surface Mount  
YES
Number of Terminals  
20
Rohs Code  
No
Part Life Cycle Code  
Obsolete
Ihs Manufacturer  
INTEGRATED DEVICE TECHNOLOGY INC
Part Package Code  
TSSOP
Package Description  
TSSOP, TSSOP20,.25
Moisture Sensitivity Levels  
1
Operating Temperature-Max  
70 °C
Package Body Material  
PLASTIC/EPOXY
Package Code  
TSSOP
Package Equivalence Code  
TSSOP20,.25
Package Shape  
RECTANGULAR
Package Style  
SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
Supply Voltage-Nom (Vsup)  
3.3 V
JESD-609 Code  
e0
Pbfree Code  
No
Terminal Finish  
Tin/Lead (Sn85Pb15)
HTS Code  
8542.39.00.01
Terminal Position  
DUAL
Terminal Form  
GULL WING
Peak Reflow Temperature (Cel)  
240
Number of Functions  
1
Terminal Pitch  
0.65 mm
Reach Compliance Code  
not_compliant
Time@Peak Reflow Temperature-Max (s)  
20
Pin Count  
20
JESD-30 Code  
R-PDSO-G20
Qualification Status  
Not Qualified
Supply Voltage-Max (Vsup)  
3.465 V
Temperature Grade  
COMMERCIAL
Supply Voltage-Min (Vsup)  
3.135 V
Family  
8523
Seated Height-Max  
1.2 mm
Logic IC Type  
LOW SKEW CLOCK DRIVER
Prop. Delay@Nom-Sup  
1.6 ns
Propagation Delay (tpd)  
1.6 ns
Same Edge Skew-Max (tskwd)  
0.03 ns
Number of True Outputs  
4
Input Conditioning  
DIFFERENTIAL MUX
Length  
6.5 mm
Width  
4.4 mm
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Häufig gestellte Fragen

What is the ICS8523?

a low skew, high performance 1-to-4 Differential-to-LVHSTL fanout buffer

How many selectable clock inputs does the ICS8523 have?

two

Which pair can accept most standard differential input levels?

CLK, nCLK pair

What can the PCLK, nPCLK pair accept?

LVPECL, CML, or SSTL

The clock enable is internally synchronized to eliminate runt pulses on the outputs during what?

asynchronous assertion/deassertion of the clock enable pin

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Kynix Teil #: KYundefined-undefined
Hersteller Teil #:
Produktkategorie:
Hersteller:
Beschreibung: Low Skew Clock Driver, 4 True Output(s), 0 Inverted Output(s), PDSO20, 6.50 X 4.40 MM, 0.92 MM HEIGHT, MS-153, TSSOP-20
Verpackung:
Menge:
Bleifrei-Status / RoHS-Status Bleifrei / RoHS-konform
Vorlaufzeit: 3(168 Hours)
Datenblatt: datasheet  Datenblatt
Lagerbestand: 0 Kann sofort geliefert werden
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